Verilog Listente.
Modulo / Design del Verilog appiattizzato, istanze appiattire / gerarchie ...
21 MB
 | Verilog RTL Parser.Parser Verilog basato su Java |
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Verilog RTL Parser. Classifica e riepilogo
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- Licenza:
- GPL
- Nome editore:
- Kanai Lal Ghosh
- Sistemi operativi:
- Windows All
- Dimensione del file:
- 22 MB
Verilog RTL Parser. Tag
Verilog RTL Parser. Descrizione
Verilogparser è un parser semplice, accessibile e pratico che è stato sviluppato per coloro che vogliono progettare la propria utilità intorno a Verilog RTL. Questo parser è stato sviluppato in Java per renderlo indipendente dalla piattaforma. Legge RTL e popola le sue strutture dati interne. Ci sono API per estrarre le informazioni di progettazione dal database, ci sono API per elaborare ogni elemento di design insieme alle funzionalità di valutazione dell'espressione.
Verilog RTL Parser. Software correlato
